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本设计提出了一种基于CPLD的0.01S计时器的设计方案。应用高速集成电路以硬件描述语言VHDL语言描述,采用Altera公司的可编程逻辑器件(CPLD)EPM7064SL84实现的现代智能计时仪表,为广大用户提供了方便。系统具有可靠性高,便于功能扩展,成本低,易普及等优点。 相似文献
994.
995.
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介绍出口斯里兰卡动车组拖车转向架的设计、制造及试验过程，针对斯里兰卡铁路的实际条件详细说明在产品设计中所采取的措施。 相似文献
997.
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