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循环冗余校验编译码的并行处理研究及其FPGA实现 总被引:4,自引:0,他引:4
针对高速通信信道的误码检测,在传统串行CRC的产生和校验的基础上,推导和建立了并行8位CRC的逻辑关系,并在FPGA上编程实现。同时这种并行处理方法也适合于其它位宽的CRC电路,为高速数据的可靠传输提供了可靠保障。 相似文献
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